- 相關推薦
基于VHDL的DDS的設計與分析
全部作者： 周雷 許文建 第1作者單位： 徐州中國礦業(yè)大學信息與電氣工程學院 論文摘要： 本文討論了基于FPGA芯片的直接數(shù)字頻率合成器（DDS）的設計方法。因為DDS的實現(xiàn)依賴于高速、高性能的數(shù)字器件，使用現(xiàn)場可編程器件FPGA，利用其高速、高性能及可重構性的特性，就能根據(jù)需要方便地實現(xiàn)各種不同頻率的信號輸出。 關鍵詞： 直接數(shù)字頻率合成器，相位累加器，VHDL (瀏覽全文) 發(fā)表日期： 2007年11月02日 同行評議：
（暫時沒有）
綜合評價： （暫時沒有） 修改稿：【基于VHDL的DDS的設計與分析】相關文章：
基于VHDL的I2C總線控制核設計03-18
基于DDS技術的聲納信號模擬器03-21
基于DDS技術的正弦衰減信號源03-07
信號源及DDS雜散分析03-07
DDS的幅度量化雜散分析(一)03-07
基于DDS技術的智能超聲波功率源的研制03-18